網絡工程師全國計算機技術與軟件技術考試(doc 25頁)
網絡工程師全國計算機技術與軟件技術考試(doc 25頁)內容簡介
網絡工程師全國計算機技術與軟件技術考試內容提要:
以下關於CPU的敘述中,錯誤的是 (1) 。
(1)A.CPU產生每條指令的操作信號並將操作信號送往相應的部件進行控製
B.程序控製器PC除了存放指令地址,也可以臨時存儲算術/邏輯運算結果
C.CPU中的控製器決定計算機運行過程的自動化
D.指令譯碼器是CPU控製器中的部件
試題解析: PC不可以存儲算術/邏輯運算結果。 答案:(1)B
以下關於CISC(Complex Instruction Set Computer,複雜指令集計算機)和RISC(Reduced Instruction Set Computer,精簡指令集計算機)的敘述中,錯誤的是 (2) 。
(2)A.在CISC中,其複雜指令都采用硬布線邏輯來執行
B.采用CISC技術的CPU,其芯片設計複雜度更高
C.在RISC中,更適合采用硬布線邏輯執行指令
D.采用RISC技術,指令係統中的指令種類和尋址方式更少
試題解析: CISC 的指令係統對應的控製信號複雜,大多采用微程序控製器方式。 答案:(2)A
以下關於校驗碼的敘述中,正確的是 (3) 。
(3)A.海明碼利用多組數位的奇偶性來檢錯和糾錯
B.海明碼的碼距必須大於等於1
C.循環冗餘校驗碼具有很強的檢錯和糾錯能力
D.循環冗餘校驗碼的碼距必定為1
試題解析: 海明碼使用多組數位進行異或運算來檢錯和糾錯。不過,異或也可以當做是奇偶計算,因此A可以算是正確的。
B的錯誤在於碼距不能等於1。 C的錯誤在於CRC不具有糾錯能力。
取兩個相近的碼字,如0和1,再隨便用個生成多項式(如101)進行計算,可以看出即使要傳輸的碼字的碼距為1,但整個編碼(原數據+CRC校驗碼)的碼距必定大於1。如果碼距可以等於1的話,那麼就意味著CRC編碼可能無法檢查出一位的錯誤。因此D也是錯誤的。
不過,D的表達存在不嚴謹的地方。如果將題目中的“循環冗餘校驗碼”定為整個編碼(原數據+CRC校驗碼),則D是錯誤的。如果將題目中的“循環冗餘校驗碼”定為CRC校驗碼,則D是正確的。 答案:(3)A
以下關於Cache的敘述中,正確的是 (4) 。
(4)A.在容量確定的情況下,替換算法的時間複雜度是影響Cache命中率的關鍵因素
B.Cache的設計思想是在合理成本下提高命中率
C.Cache的設計目標是容量盡可能與主存容量相等
D.CPU中的Cache容量應該大於CPU之外的Cache容量
試題解析: A、C、D都明顯錯誤。 答案:(4)B
…………
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以下關於CPU的敘述中,錯誤的是 (1) 。
(1)A.CPU產生每條指令的操作信號並將操作信號送往相應的部件進行控製
B.程序控製器PC除了存放指令地址,也可以臨時存儲算術/邏輯運算結果
C.CPU中的控製器決定計算機運行過程的自動化
D.指令譯碼器是CPU控製器中的部件
試題解析: PC不可以存儲算術/邏輯運算結果。 答案:(1)B
以下關於CISC(Complex Instruction Set Computer,複雜指令集計算機)和RISC(Reduced Instruction Set Computer,精簡指令集計算機)的敘述中,錯誤的是 (2) 。
(2)A.在CISC中,其複雜指令都采用硬布線邏輯來執行
B.采用CISC技術的CPU,其芯片設計複雜度更高
C.在RISC中,更適合采用硬布線邏輯執行指令
D.采用RISC技術,指令係統中的指令種類和尋址方式更少
試題解析: CISC 的指令係統對應的控製信號複雜,大多采用微程序控製器方式。 答案:(2)A
以下關於校驗碼的敘述中,正確的是 (3) 。
(3)A.海明碼利用多組數位的奇偶性來檢錯和糾錯
B.海明碼的碼距必須大於等於1
C.循環冗餘校驗碼具有很強的檢錯和糾錯能力
D.循環冗餘校驗碼的碼距必定為1
試題解析: 海明碼使用多組數位進行異或運算來檢錯和糾錯。不過,異或也可以當做是奇偶計算,因此A可以算是正確的。
B的錯誤在於碼距不能等於1。 C的錯誤在於CRC不具有糾錯能力。
取兩個相近的碼字,如0和1,再隨便用個生成多項式(如101)進行計算,可以看出即使要傳輸的碼字的碼距為1,但整個編碼(原數據+CRC校驗碼)的碼距必定大於1。如果碼距可以等於1的話,那麼就意味著CRC編碼可能無法檢查出一位的錯誤。因此D也是錯誤的。
不過,D的表達存在不嚴謹的地方。如果將題目中的“循環冗餘校驗碼”定為整個編碼(原數據+CRC校驗碼),則D是錯誤的。如果將題目中的“循環冗餘校驗碼”定為CRC校驗碼,則D是正確的。 答案:(3)A
以下關於Cache的敘述中,正確的是 (4) 。
(4)A.在容量確定的情況下,替換算法的時間複雜度是影響Cache命中率的關鍵因素
B.Cache的設計思想是在合理成本下提高命中率
C.Cache的設計目標是容量盡可能與主存容量相等
D.CPU中的Cache容量應該大於CPU之外的Cache容量
試題解析: A、C、D都明顯錯誤。 答案:(4)B
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